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Features
HIGH-SPEED 36K (4K x 9-BIT)
SYNCHRONOUS PIPELINED
DUAL-PORT SRAM
IDT709149S
◆
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◆
Architecture based on Dual-Port SRAM cells
– Allows full simultaneous access from both ports
High-speed clock-to-data output times
– Commercial: 8/10/12ns (max.)
– Industrial: 10ns (max.)
Low-power operation
– IDT709149S
Active: 1500mW (typ.)
Standby: 75mW (typ.)
4K X 9 bits
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◆
Synchronous operation
– 4ns setup to clock, 1ns hold on all control, data, and
address inputs
– Data input, address, and control registers
– Fast 8ns clock to data out
13ns cycle time, 76MHz operation in pipeline mode
– Self-timed write allows for fast cycle times
TTL-compatible, singles 5V (±10%) power supply
Clock Enable feature
Guaranteed data output hold times
Industrial temperature range (–40°C to +85°C) is available
for selected speeds.
Functional Block Diagram
MEMORY
I/O 0-8L
OE L
WRITE
LOGIC
SENSE
AMPS
MEMOR
Y ARRAY
ARRAY
DECODER DECODER
REG
REG
en
en
WRITE
LOGIC
SENSE
AMPS
0/1
0
1
I/O 0-8R
FT/PIPED R
OE R
CLK L
CLKEN L
CLK R
CLKEN R
R/ W L
REG
Self-
timed
Write
Logic
Self-
timed
Write
Logic
REG
R/ W R
CE L
A 0L -A 11L A 0R -A 11R
CE R
3494 drw 01
JANUARY 2009
1
?2009 Integrated Device Technology, Inc.
DSC-3494/6
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